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Le langage VHDL : du langage au circuit, du circuit au langage
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Librairie Eyrolles - Paris 5e
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Le langage VHDL : du langage au circuit, du circuit au langage

Le langage VHDL : du langage au circuit, du circuit au langage

Cours et exercices corrigés

Jacques Weber, Sébastien Moutault, Maurice Meaudre - Collection Sciences sup - Sciences de l'ingénieur

320 pages, parution le 08/06/2016 (5eme édition)

Résumé

Cet ouvrage s'adresse aux étudiants des licences et des masters EEA ainsi qu'aux élèves des écoles d'ingénieurs.

L'utilisation d'un langage de description évolué comme VHDL ou Verilog dans la modélisation et la conception des circuits intégrés est aujourd'hui indispensable.

VHDL poursuit son évolution pour développer ses capacités de vérification. La bibliothèque OSVVM (Open Source VHDL Verification Methodology), dernière avancée dans ce domaine, fait l'objet d'un nouveau chapitre dans cette cinquième édition. Cet ouvrage est construit en cinq parties :

  • Les concepts de base de la description et de la simulation des circuits avec VHDL.
  • La mise en oeuvre du langage pour la conception,
  • La sémantique du langage et les outils de modélisation,
  • La syntaxe du langage VHDL,
  • Le standard VHDL 2008 et la bibliothèque OSVVM.

Le cours est complété par 12 exercices et problèmes (avec leur corrigé en ligne).

Des compléments en ligne (exercices complémentaires, informations sur les modules IP (Intellectual Property) et sur le standard Wishbone, liens vers des sites VHDL...) sont disponibles en téléchargement libre à l'adresse suivante : www.dunod.com/contenus-complementaires/

L'auteur - Jacques Weber

Jacques Weber - Maître de conférences à l'IUT de Cachan, diplômé de l'Ecole supérieure d'électricité.

Autres livres de Jacques Weber

L'auteur - Sébastien Moutault

Sébastien Moutault - Professeur agrégé de génie électrique à l'IUT de Bordeaux, ancien élève de l'Ecole Normale Supérieure de Cachan

L'auteur - Maurice Meaudre

Maurice Meaudre - Ancien chef de travaux à l'IUT de Cachan (décédé)

Sommaire

Modélisation etsynthèse : le même langage. Conception et vérification, le langage VHDL à travers un projet. Un contrôleur de liaison série asynchrone. Décrire le circuit. Vérifier son fonctionnement. Quelques pièges. Simulation de la sémantique du langage VHDL au modèle rétro-annoté vital. Parallélismes et algorithmes séquentiels : signaux, variables et processus. Bus, conflits et arithmétiques de vecteurs : le standard IEEE-1076.3. Communiquer avec l'environnement et le simulateur. Violation des règles temporelles. Le langage VHDL, éléments de syntaxe. Le formalisme de Backus et Naur. Les objets du langage. Les instructions. Structures d'un programme.

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Avis des lecteurs

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Note basée sur 1 commentaire (voir tous les commentaires)

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Commentaire de Luis S
publié le 15/04/2017
Acheteur vérifié

Très bien

Le livre n'est pas chère et complet. Le service de livraison est nickel et le délai de réception est assez court. Malheureusement la couverture du livre était plié. Mise à part ce petit bémol, je recommande ce site.

Caractéristiques techniques

  PAPIER NUMERIQUE
Éditeur(s) Dunod
Auteur(s) Jacques Weber, Sébastien Moutault, Maurice Meaudre
Collection Sciences sup - Sciences de l'ingénieur
Parution 08/06/2016 08/06/2016
Édition  5eme édition
Nb. de pages 320 304
Format 17 x 24 -
Couverture Broché -
Poids 510g -
Intérieur Noir et Blanc -
Contenu - PDF
EAN13 9782100726882 9782100752386
ISBN13 978-2-10-072688-2 -

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